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Paquet : verilator (5.038-1)

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simulateur Verilog libre et rapide

Verilator est le simulateur Verilog HDL libre le plus rapide, dépassant beaucoup de simulateurs commerciaux. Il compile du Verilog synthétisable (mais pas du code de banc d’essai !), plus quelques assertions PSL, SystemVerilog ou Synthesis dans du code C++ ou SystemC. Il est conçu pour de vastes projets où des performances rapides de simulation sont le souci principal, et il convient parfaitement pour créer des modèles d’exécutables de CPU pour des équipes concevant des logiciels embarqués.

Étiquettes: Domaine: Électronique, Mis en œuvre en: C++, implemented-in::perl, interface::commandline, Rôle: Programme, But: Simulation

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arm64 7 089,6 ko36 903,0 ko [liste des fichiers]
armhf 6 814,5 ko24 098,0 ko [liste des fichiers]
i386 8 204,9 ko34 158,0 ko [liste des fichiers]
ppc64el 7 716,4 ko42 599,0 ko [liste des fichiers]
riscv64 7 975,0 ko32 715,0 ko [liste des fichiers]
s390x 7 499,1 ko37 955,0 ko [liste des fichiers]